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一种多处理器视频编码芯片装置和方法

一种多处理器视频编码芯片装置和方法

  • 专利类型:发明专利
  • 有效期:不限
  • 发布日期:2021-07-15
  • 技术成熟度:详情咨询
交易价格: ¥面议
  • 法律状态核实
  • 签署交易协议
  • 代办官方过户
  • 交易成功

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  • 技术(专利)类型 发明专利
  • 申请号/专利号 CN200810104205.9 
  • 技术(专利)名称 一种多处理器视频编码芯片装置和方法 
  • 项目单位 中国科学院计算技术研究所
  • 发明人 纪雯;陈益强 
  • 行业类别 电学
  • 技术成熟度 详情咨询
  • 交易价格 ¥面议
  • 联系人 李志文
  • 发布时间 2021-07-15  
  • 01

    项目简介

    本发明公开了一种多处理器视频编码芯片装置和方法。其装置包括具有多个处理器的多核编码器,以及图像切片单元。其中图像切片单元用于将视频图像划分为多个切片,并将每个切片分配到多核编码器的不同处理器中进行处理;多核编码器用于在利用多个处理器对图像的切片进行处理的过程中,采用并行流水的方式执行图像编码;并在多核编码器的处理器处理完一个切片后,给图像切片单元发送消息以使图像切片单元发送下一个切片给该处理器。以及频率控制单元,用于使用动态频率调节方法,调节多核编码器中的处理器的处理速度。其能够很大程度上降低功耗,而且不影响整个任务的运行速度。
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  • 02

    说明书


    1.一种多处理器视频编码芯片装置,其特征在于,包括具有多个处理器的多核编码器、图像切片单元,以及频率控制单元,其中:所述图像切片单元,用于将视频图像的一幅图像划分为多个切片,并将每个切片分配到多核编码器的不同处理器中进行处理;所述多核编码器,用于在利用多个处理器对图像的切片进行处理的过程中,采用并行流水的方式执行图像编码;所述频率控制单元,用于使用动态频率调节方法,调节多核编码器中的处理器的处理速度,以使得每个处理器在处理图像切片的过程中同步工作。
    2.根据权利要求1所述的多处理器视频编码芯片装置,其特征在于,所述多核编码器,还用于在多核编码器的处理器处理完一个切片后,给图像切片单元发送消息以使图像切片单元发送下一个切片给该处理器。
    3.根据权利要求1所述的多处理器视频编码芯片装置,其特征在于,所述多核编码器包括多个处理器,每个处理器包含视频编码的全部处理模块,即所述处理器包含:运动估计模块,预测模块,变换模块,量化模块,去方块滤波模块以及熵编码模块。
    4.根据权利要求3所述的多处理器视频编码芯片装置,其特征在于,所述量化模块每次并行处理n个数据,即量化n个数据只需要1个单位时钟;所述预测模块采用多模式并行运行的方式进行操作。
    5.根据权利要求1所述的多处理器视频编码芯片装置,其特征在于,所述切片包含多个整宏块,一幅视频图像中每片的宏块数不固定。
    6.一种多处理器视频编码方法,其特征在于,包括下列步骤:步骤A,将视频图像的一幅图像划分为多个切片,并将每个切片分配到多核编码器的不同处理器中进行处理;步骤B,在利用多个处理器对图像的切片进行处理的过程中,采用并行流水的方式执行图像编码;步骤C,使用动态频率调节方法,调节多核编码器中的处理器的处理速度,以使每个处理器在处理图像切片的过程中同步工作。 
    7.根据权利要求6所述的多处理器视频编码方法,其特征在于,所述步骤B还包括下列步骤:步骤B’,在多核编码器的处理器处理完一个切片后,给图像切片单元发送消息以使图像切片单元发送下一个切片给该处理器。
    8.根据权利要求6所述的多处理器视频编码方法,其特征在于,所述步骤B包括下列步骤:步骤B1,所述多核编码器中的处理器的每个模块也可以划分为多任务并行的方式执行。
    9.根据权利要求8所述的多处理器视频编码方法,其特征在于,所述步骤B1包括下列步骤:在运行估计模块中,采用宏块多个划分模式并行搜索的方法来寻找绝对误差和最小的那个宏块划分模式,每次计算时都记录下各种划分模式的当前具有最小的绝对误差和及运动矢量;如果搜索到的宏块误差和小于该当前最小的绝对误差和,则将当前运动矢量作为当前匹配的宏块,最小的绝对误差和也更新为该块的绝对误差和,否则,直接进行下一步搜索;最后选择绝对误差和最小的模式作为最优化编码模式。
    10.根据权利要求6所述的多处理器视频编码方法,其特征在于,所述步骤A还包括下列步骤:切片在分配给多核编码器进行处理时,首先发送到多核编码器的共享的参考图像缓冲区。
    11.根据权利要求6所述的多处理器视频编码方法,其特征在于,所述步骤C中,所述动态频率调节方法,是:设在一时刻i,运动估计模块的执行时钟周期为CMEi;预测模块的执行时钟周期Cpredi;变换模块的执行时钟周期CDCTi;量化模块的执行时钟周期为CQPi;熵编码模块的执行时钟周期CHi;去方块滤波模块的执行时钟周期CDBi;同时,运动估计模块的执行时钟频率为fMEi;量化模块的执行时钟频率为fQPi;变换模块的执行时钟频率fDCTi;预测模块的执行时钟频率fpredi;熵编码模块的执行时钟频率fHi;去方块滤波模块的执行时钟频率fDBi; 设在所述模块中,执行周期最长的任务模块的时钟周期定义为Cmaxi,那么其它模块就以执行周期最长的任务模块为基准进行频率调节;每个模块调节后的频率为(fMEi′,fpredi′,fDCTi′,fQPi′,fHi′,fDBi′),其中
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