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一种内存访问信息实时捕获装置及访存信息捕获方法

一种内存访问信息实时捕获装置及访存信息捕获方法

  • 专利类型:发明专利
  • 有效期:不限
  • 发布日期:2021-07-15
  • 技术成熟度:详情咨询
交易价格: ¥面议
  • 法律状态核实
  • 签署交易协议
  • 代办官方过户
  • 交易成功

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  • 技术(专利)类型 发明专利
  • 申请号/专利号 CN200510008612.6 
  • 技术(专利)名称 一种内存访问信息实时捕获装置及访存信息捕获方法 
  • 项目单位 中国科学院计算技术研究所
  • 发明人 李磊;陈明宇;曹政;樊建平 
  • 行业类别 物理
  • 技术成熟度 详情咨询
  • 交易价格 ¥面议
  • 联系人 李志文
  • 发布时间 2021-07-15  
  • 01

    项目简介

    本发明公开了一种内存访问信息实时捕获装置及访存信息捕获方法,该装置包括内存信号捕获逻辑单元、数据缓冲区单元、高速数据接口单元、嵌入式处理器单元及配置缓冲区单元,这些逻辑单元利用高速IO、大容量RAM和嵌入式处理器,实现高速内存接口和数据发送接口,并对数据进行预处理,所述内存访问信息实时捕获装置接收内存控制器信号。由于采用了并联的DDR内存接口作为捕获接口,以高速FIFO和高速IO进行数据存储、传送,由操作系统补丁和工具软件作为支持实现的。本发明所提供的装置能够在不修改原有系统硬件、对系统性能影响很小的情况下,实现实时、高速的访存信息捕获。
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  • 02

    说明书

    1、一种内存访问信息实时捕获,包括内存信号捕获逻辑单元10、数据缓冲区单元20、 高速数据接口单元30、嵌入式处理器单元40及配置缓冲区单元50;这些逻辑单元利用高 速IO、大容量RAM和嵌入式处理器,实现高速内存接口和数据收发接口,并对数据进行 预处理,所述内存访问信息实时捕获装置接收内存控制器信号; 其中,内存信号捕获逻辑单元10实现了JEDEC DDR RAM规范的子集,对DDR内 存的命令进行解析,对地址和数据进行识别和捕获; 数据缓冲区单元20包括高速FIFO缓冲区和相关控制逻辑,内存信号捕获逻辑 单元10将捕获的信息写入该FIFO;FIFO提供空、满、计数器,供流量控制使用; 高速数据接口单元30用于将数据送往主机,或者接收主机传来的控制和配置命 令传给配置缓冲区单元50; 配置缓冲区单元50通过内存信号捕获逻辑单元10接收捕获规则,用以对信息 进行过滤,并将过滤后的信息传给内存信号捕获逻辑单元10。 2、如权利要求1所述的一种内存访问信息实时捕获装置,其特征在于,内存访 问信息实时捕获装置通过内存总线上出现的内存控制器信号,识别命令、地址和数 据。 3、如权利要求1所述的一种内存访问信息实时捕获装置,其特征在于,内存访 问信息实时捕获装置使用USB2.0接口或Xilinx专用高速IO通道实现捕获数据的传 送。 4、如权利要求1所述的一种内存访问信息实时捕获装置,其特征在于,高速数 据接口单元30将数据缓冲区单元20中的数据打包,通过USB接口或高速串行通道 发送到主机进行存储和分析,数据缓冲区单元20、高速数据接口单元30和上层驱动 程序共同配合,进行流量控制。 5、如权利要求1所述的一种内存访问信息实时捕获装置,其特征在于,动态配 置配置缓冲区单元50。 6、如权利要求1所述的一种内存访问信息实时捕获装置,其特征在于,内存信 号捕获逻辑单元10由配置缓冲区单元50中的规则控制。 7、一种应用权利要求1所述的内存访问信息实时捕获装置进行访存信息捕获的 方法,包括以下步骤: a)内存访问信息实时捕获装置接收处理器通过主板的DDR插槽发来的访存信 号; b)内存信号捕获逻辑单元10捕获到访存信息; c)配置缓冲区单元50通过内存信号捕获逻辑单元10接收的捕获规则,过滤访 存信息,并将过滤后的信息传给内存信号捕获逻辑单元10; d)内存信号捕获逻辑单元10将过滤过的访存信息存入数据缓冲区单元20; e)嵌入式处理器单元40对数据缓冲区单元20中的数据进行处理; f)处理过的数据由数据缓冲区单元20送入高速数据接口单元30; g)嵌入式处理器单元40控制高速数据接口单元30,将处理过的数据送出。
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